T
tooh83
Guest
안녕하세요, 모두들
난 floorplanning을 배우고 싶다.아무도 내게 좋은 입문 floorplanning 자료를
제공할 수있습니다.사전에 고맙습니다
난 floorplanning을 배우고 싶다.아무도 내게 좋은 입문 floorplanning 자료를
제공할 수있습니다.사전에 고맙습니다
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zhongdg
Guest
어떤 도구를 사용할까요?아스트로 또는 SoC를 발생?아마도 당신을 위해 다음의 재료에 유용합니다.
미안하지만, 당신이 첨부 파일을보기 위해서는 로그인이 필요
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Z
zhongdg
Guest
또 다른 소재
미안하지만, 당신이 첨부 파일을보기 위해서는 로그인이 필요
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tooh83
Guest
내가 뭘 floorplanning는 처음에 잘하려면 어떻게해야합니까?floorplan하는 방법?floorplanning 알고리즘?한 걸음 - 의해 - 영어로 floorplanning 예를 및 plz 단계
L
layoutmaster
Guest
안녕하세요, 다음 Floorplan 토론에 내 게시물은 몇 개월 전에 이미 만들어보세요 ... :
http://www.edaboard.com/viewtopic.php?t=307344&highlight =
http://www.edaboard.com/viewtopic.php?t=307344&highlight =
Ź
ź
Guest
정말 floorplanning
대해 배울 필요가있다??
자일링스의 장소와 경로와 floorplanning 도구가 자동으로 오른쪽으로 이루어집니다 ..
대해 배울 필요가있다??
자일링스의 장소와 경로와 floorplanning 도구가 자동으로 오른쪽으로 이루어집니다 ..
L
layoutmaster
Guest
세상이 당신과 디자인을 사용하여 어떤 작업 단, 그것에 따라 ...아마도 디지털 세계에서
칩 floorplan 할 중요하고 그 일을 위해 자동 도구에 의존하는 수 있지만, 아니다로 아날로그 - 10 년 이상의 경험과 함께, 시장에 많은 제품의 혼합 신호 설계 엔지니어 난 강력하게 비판 아날로그 부분은 어떤 칩, 반도체의 경우에도 그것은 정말 사소한 부분에있어 좋은 floorplan 좋습니다 ...
좋은 floorplan 정의되지 않은
경우에는 먼저 내 그룹 내에서, 더 나아가 디자인의 모든 단계를 승인하지 않습니다.그것은 실리콘 처리 이후 점점 좋은 및 기능적 부분에 대한 열쇠를 첫 번째 단계의 ...
칩 floorplan 할 중요하고 그 일을 위해 자동 도구에 의존하는 수 있지만, 아니다로 아날로그 - 10 년 이상의 경험과 함께, 시장에 많은 제품의 혼합 신호 설계 엔지니어 난 강력하게 비판 아날로그 부분은 어떤 칩, 반도체의 경우에도 그것은 정말 사소한 부분에있어 좋은 floorplan 좋습니다 ...
좋은 floorplan 정의되지 않은
경우에는 먼저 내 그룹 내에서, 더 나아가 디자인의 모든 단계를 승인하지 않습니다.그것은 실리콘 처리 이후 점점 좋은 및 기능적 부분에 대한 열쇠를 첫 번째 단계의 ...
Ź
ź
Guest
는 WOW !!!...
어둡 the 설명을
그건 훌륭한 답장 .. 덕분에 너무 많은 분명한 설명을위한 ..
우리가해야 할 floorplannignseperately .. 아날로그 세상이 너무에서만
그것은 디지털 세계에서뿐만 또는 도구를 자동으로 할 수있다나요??
귀하의 회신을 기다리는 ..
어둡 the 설명을
그건 훌륭한 답장 .. 덕분에 너무 많은 분명한 설명을위한 ..
우리가해야 할 floorplannignseperately .. 아날로그 세상이 너무에서만
그것은 디지털 세계에서뿐만 또는 도구를 자동으로 할 수있다나요??
귀하의 회신을 기다리는 ..
G
Guest
Guest
[No message]
V
VLSI_Designer
Guest
하이 탄,
그것은 올바른 notoin은 아날로그 전용하고 올바른 floorplanning 필요한 디자인되지 않습니다 에다 도구 floorplannig를 돌봐주지 디지털 설계를위한!!
내보기에 마우스 오른쪽 Floorplannig : :
매크로의 1) 적절한 배치 /의 SOC는 디자인의 본드 패드를 통해 내부 디자인이나 외부 세계와 상호 작용에 대한 Deisgn의 추억
2)이어야 덜 혼잡을위한 추가적인 단계가
3) 당신의 디자인에있는 매크로의 위치와 경로에 대해서는 더 적은 와이어 길이 reuiqre한다.
그럼., 디지털의 SOC, floorplan 단계별로 최적화된 설계를 위해 필요한 경우에도
슈레시
그것은 올바른 notoin은 아날로그 전용하고 올바른 floorplanning 필요한 디자인되지 않습니다 에다 도구 floorplannig를 돌봐주지 디지털 설계를위한!!
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매크로의 1) 적절한 배치 /의 SOC는 디자인의 본드 패드를 통해 내부 디자인이나 외부 세계와 상호 작용에 대한 Deisgn의 추억
2)이어야 덜 혼잡을위한 추가적인 단계가
3) 당신의 디자인에있는 매크로의 위치와 경로에 대해서는 더 적은 와이어 길이 reuiqre한다.
그럼., 디지털의 SOC, floorplan 단계별로 최적화된 설계를 위해 필요한 경우에도
슈레시
Ź
ź
Guest
하지만 어떻게 할 floorpalnning 수동으로 ..
디자인 엔지니어는 내가 함께 작업을 볼 수 자일링스 도구 ..
난 그냥 내 요구에 따라 실행을 차례로 누르고 모든 응용 프로그램을 작성 ...
그것은 모든 것을 .. 않습니다
귀하의 게시물에서
않는 최소한의 작업 .. 최대 밖으로 그것의 floorplanning .. 우리가 따로 할 필요가 얻을로 자일링스에서 floorplanning 가정
만약 그렇다면 어떻게해야 할 일을 무엇입니까??
디자인 엔지니어는 내가 함께 작업을 볼 수 자일링스 도구 ..
난 그냥 내 요구에 따라 실행을 차례로 누르고 모든 응용 프로그램을 작성 ...
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않는 최소한의 작업 .. 최대 밖으로 그것의 floorplanning .. 우리가 따로 할 필요가 얻을로 자일링스에서 floorplanning 가정
만약 그렇다면 어떻게해야 할 일을 무엇입니까??
F
FLEXcertifydll
Guest
사실, FPGA를 도메인, a 우수한 결과를 얻기를 원하는 경우에는 유, 유를 수동으로 배치 중요한 경로 또는 디자인의 최고의 타이밍을 얻을에 floorplan합니다.
수동 FPGA에서 물리적 디자인을 수정하는 작업은 매우 힘들지만, 그것은 매우 유용하고 있어야합니다.
도구를 할 수 없어 더 이상의 것들을 유를 원한다.올린날짜4 분 후 :탄
SOC와 ASIC의 도메인, floorplan에서 다시 주요 과제 - 끝을 뜻한다.유 ultilization보다 90 % 이상을 유지해야합니다.conjection 문제없습니다.전원 드롭 문제를 해결합니다.
물론, 비용과 관계가있다.그게 돈을 소득을 의미한다.
수동 FPGA에서 물리적 디자인을 수정하는 작업은 매우 힘들지만, 그것은 매우 유용하고 있어야합니다.
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물론, 비용과 관계가있다.그게 돈을 소득을 의미한다.