처리"비디오

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dianacgil

Guest
안녕하세요 ...
내가 비디오 코딩에 대한 저의 마지막 프로젝트에서 일하고 있어요.내가 HW / 소프트웨어 통합 설계 방법론 (HW : VHDL - "사이클론의 FPGA / 소프트웨어 : C -"알테라는 Nios 프로세서)와 함께 일하고 있어요.내가 DCT, 질문, 질문 - 1, IDCT 같은 사이클론에서 교장 모듈을 개발할려고 ...
지금까지, 난 (천 총통의 알고리즘은 DCT)에 생각을 해 봤는데.VHDL에서 어떻게 DCT 구현에 대해 어떤 생각을 가지고 있습니까?제가 알고리즘의 흐름을 가지고 있지만 VHDL로 어떻게 번역해야할지 모르겠다.

<img src="http://www.edaboard.com/images/smiles/icon_question.gif" alt="질문" border="0" />고마워.

 
안녕,

귀하의 질문이 모호합니다.당신은 문제가 정교하고 문제의 정확한 요구 사항을 설명합니다.

특히 당신이 인터페이스 (입력 / 출력) 및 타이밍 요구 사항에 대해 자세히 (실제 시간 / off - line 항목 솔루션) 생각해야합니다.

일단 당신이 모두 다음 코딩을 진행할 수있습니다하기로 결정했다.이후 귀하의 전체 구현 사양에 따라 따라서 당신은 매우 더 명시적으로 귀하의 시스템 요구 사항을 정교하게 필요에 따라 다릅니다.핵심 모듈의 유형을 설명합니다 이건 (adder 예를 들어, 배율).만약 당신이 단순히 당신의 코어를 연결할 수있습니다 DCT 알고리즘은 다음의 적절한 나비가 DCT의 결과를 얻으려면 모듈.그래서 하드웨어 구현에 큰 문제는 시스템이 재부 요구 사항입니다.감사합니다,

 
전체 디자인을 먼저 생각해야하고, 입력을 찾을 수 / 출력 요구 사항을 시도하는 방법을 spli 모듈 디자인을 결정, 그럼만큼 각 모듈 가능한 definitations로서, 포기 여부를 필요에 맞게 방법을 알고리즘을 수정을 참조하십시오 하드웨어 장치.

또한, VHDL과 같은 구글 뉴스 그룹, 확인하기 위해 몇 가지 힌트를 찾을 수있습니다.

행운을 빕니다.

<img src="http://www.edaboard.com/images/smiles/icon_smile.gif" alt="미소" border="0" />
 
좋아.
내가 DCT 구현 - VHDL 차원의 노력했습니다.전 총통의 알고리즘과 함께하지만 지금 문제는 내 디자인 크다 : 2500 레 약 일하고 있어요.(사용하는 사이클론).기본적인 아이디어는 동시 양식에서 16 multiplications 26 추가 구현하지만 결과는 그 논리는 자원의 비효율적 측면에서 말해.1 adder 1 배율은 재사용에 따라서 훨씬 더 나은 생각하지만, 16 mult하고.26 추가할 수있습니다., 대신에 같은 시간에 16 배율 16 adders을 구현했다.이걸 어떻게해야합니까?
어떤 도움?

감사합니다!

 
대답이 신문에있습니다.그것을 즐기십시오.
미안하지만, 당신이 첨부 파일을 보려면 로그인이 필요합니다

 
난 당신 아나로그 디바이스의 ADV202 같은 헌신 비디오 코덱을 사용하는 것이 좋습니다.많은 표준 디지털 비디오 포맷의 JPEG2000 프로세서와 호환됩니다.
만약 당신이 PLD, 당신을 위해 도움이 될 수있습니다 비디오 처리 IP 코어를 사용하는 고집, 내가 opencore.org에서 제공하는 기억.행운을 빕니다.

 
정말 당신이 무엇을 할 수있다 먼저 귀하의 기본 하드웨어 아키텍처마다 최적화된 산술 논리를 사용하는 나비를 단순화하는 것입니다.그리고 당신은 또한 공간의 맥락에서 효율적으로 적은 클럭 사이클이 걸릴 수있습니다 빠른 곱셈기 adders 빠르게 구현할 수있습니다.빠른 배율과 이스라엘을 Koren의 도서 refere 수있습니다 adders 들어, 그것을 확실히하는 데 유용 빠른 연산이 많은 알고리즘이 포함되어있습니다.그리고 adder 내가 배율은 당신이 구성 요소를 재사 용할 수에게 제안할 것이다 수를 말합니다.하지만 당신은 적절한 숫자를 선택할 수있습니다 배율 및 adders ...................
그렇지 않으면 DCT 구현하기 어려운 알고리즘이되지 않습니다.
안부.

 

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