종지에 변수 콘덴서를 생성하려면 어떻게해야하나요?

D

Davidy

Guest
그런 아래 그림의 고사와 같은 억양에 변수 콘덴서를 생성하려고합니다. CS는 1kHz의 frequncy 년에 용량성 가치를 변화하고 있습니다. 나는 VerilogA 언어를 사용하여 CS를 만들어보십시오. 하지만 이것은 varible 전류를 생성할 수 있습니다.
80_1161604202.gif
생각을 종이 전압 제어 전류 소스 및 다른 의존 소스와 Pspice에서 varable 콘덴서를 생성 나타났습니다. 하지만 유령의 시뮬레이션을위한 케이던스에서 구현하는 방법을 모르겠어요. 난 단 한번도 시도했지만 전압 제어 전류 소스는 종이 '변수 콘덴서 "내가 업로드하는 방법에 사용할 수 없습니다. http://www.edaboard.com/viewtopic.php?p=709127 # 709127 누구든지 시간과 그 가치를 변경하는 실제 varable 콘덴서를 생성 내게 도움이 될 수 있습니다. [/URL]
 
그것은에서를 작성하는 것이 가능하지 않겠 verilog - A : C = C0 * V (제어) I (아웃)
 
나는 종이 설명으로 등가 회로를 구축하기 위해 케이던스의 analogLib에서 구성 요소를 사용하고 싶습니다. 하지만 종속 소스를 사용하는 방법을 모르겠어요. 이것은 정말 좋은 조언이 필요합니다.
 
그런 아래 그림의 고사와 같은 억양에 변수 콘덴서를 생성하려고합니다. CS는 1kHz의 frequncy 년에 용량성 가치를 변화하고 있습니다. 나는 VerilogA 언어를 사용하여 CS를 만들어보십시오. 하지만 이것은 varible 전류를 생성할 수 있습니다.
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생각을 종이 전압 제어 전류 소스 및 다른 의존 소스와 Pspice에서 varable 콘덴서를 생성 나타났습니다. 하지만 유령의 시뮬레이션을위한 케이던스에서 구현하는 방법을 모르겠어요. 난 단 한번도 시도했지만 전압 제어 전류 소스는 종이 '변수 콘덴서 "내가 업로드하는 방법에 사용할 수 없습니다. http://www.edaboard.com/viewtopic.php?p=709127 # 709127 누구든지 시간과 그 가치를 변경하는 실제 varable 콘덴서를 생성 내게 도움이 될 수 있습니다. [/URL]
 
그것은에서를 작성하는 것이 가능하지 않겠 verilog - A : C = C0 * V (제어) I (아웃)
 
나는 종이 설명으로 등가 회로를 구축하기 위해 케이던스의 analogLib에서 구성 요소를 사용하고 싶습니다. 하지만 종속 소스를 사용하는 방법을 모르겠어요. 이것은 정말 좋은 조언이 필요합니다.
 

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