S
sanJerry2004
Guest
아무도 나에게는 50Hz의 도입을 줄 수 ~ 2MHz의 클록 제너레이터 칩은?1 단계 Hz에서.
내 원래 BERT 디자인의 데이터 패턴을 평가는 50Hz
~ 2MHz의에서 원하는 해상도 조정을 지속적으로 1 Hz에서.
내 원래 BERT 디자인의 데이터 패턴을 평가는 50Hz
~ 2MHz의에서 원하는 해상도 조정을 지속적으로 1 Hz에서.
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G
Guest
Guest
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E
echo47
Guest
DDS를 잘 작동합니다.어쩌면이 비슷한 논의를하면 도움이됩니다 :
http://www.edaboard.com/viewtopic.php?t=147068
http://www.edaboard.com/viewtopic.php?t=152927
http://www.edaboard.com/viewtopic.php?t=147068
http://www.edaboard.com/viewtopic.php?t=152927
S
sanJerry2004
Guest
응, TKS.나는 또한 할 수의 DDS 칩 알았어.BTW, 우리는 FPGA의 기능을 실현 수있습니다.모든 의견 pls.
E
echo47
Guest
당신,하지만 DAC는, 필터링 및 비교기 등과 같은 아날로그 부품 FPGA에서 DDS를의 디지털 부분을하지 구현할 수있습니다.