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Guest
안녕하세요, 모두
혼합 언어와 난은 RTL 코딩과 내가 의해 혼란 스러워요
문제 없어.Verilog HDL을 할 때 프로그램을 작성, 난 인스턴트 싶어요
VHDL에 정의된 구성 요소지만, VHDL에서 몇 가지 ""미등록 상표 약품입니다
내가 어떻게 이런 "geneic는"Verilog의 가치를 전달할 수있습니다.
PLZ, 정말 고마워 내게 도움이됩니다.
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