R
renhong.yen
Guest
안녕 여러분
난 디지털 회로를위한 LDO를 설계하고있는 중이야.
출력 전압은 1.8V의 유사 콘텐츠에만 사양은 10 % 미만이어야합니다.이 LDO를위한 요구 사항.
난 디지털 설계자는 항상 평균 currnet (권력)의 분산 설계에 대해, 그 피크 전류 밖으로 남아있을 수있습니다 이것은 무슨 의미 하든지 상관 궁금 무엇입니까?
내 경우엔, 평균 소비 전류 35mA지만, 최대 350mA 이상의 것입니다 현재입니다.
피크 전류 모든 클럭 에지에서 발생합니다.나는 이런 현상을 소위 스위칭 잡음라는 것 같아 몇 가지를 참조 신문을 읽지 않았다.
이 스위칭 노이즈를 돌봐 줄까?!
LDO 인 경우 즉시 모든 클럭 가장자리에 350mA를 제공해야합니다 그것은, 그것은 하드의 사양을 충족하는 끔찍한 것으로 보인다.10 % 유사 Vout있습니다.
나쁜 영어 죄송 해요, 난 너희들은 내가 문제가 발생시 어떻게 이해할 수 있기를 바랍니다.
누구 좀 도와 드릴까요?!
고마워요!
안부 인사
RH
난 디지털 회로를위한 LDO를 설계하고있는 중이야.
출력 전압은 1.8V의 유사 콘텐츠에만 사양은 10 % 미만이어야합니다.이 LDO를위한 요구 사항.
난 디지털 설계자는 항상 평균 currnet (권력)의 분산 설계에 대해, 그 피크 전류 밖으로 남아있을 수있습니다 이것은 무슨 의미 하든지 상관 궁금 무엇입니까?
내 경우엔, 평균 소비 전류 35mA지만, 최대 350mA 이상의 것입니다 현재입니다.
피크 전류 모든 클럭 에지에서 발생합니다.나는 이런 현상을 소위 스위칭 잡음라는 것 같아 몇 가지를 참조 신문을 읽지 않았다.
이 스위칭 노이즈를 돌봐 줄까?!
LDO 인 경우 즉시 모든 클럭 가장자리에 350mA를 제공해야합니다 그것은, 그것은 하드의 사양을 충족하는 끔찍한 것으로 보인다.10 % 유사 Vout있습니다.
나쁜 영어 죄송 해요, 난 너희들은 내가 문제가 발생시 어떻게 이해할 수 있기를 바랍니다.
누구 좀 도와 드릴까요?!
고마워요!
안부 인사
RH